arquitectura de conjunt d'instruccions de 64 bits discontinuada d'Intel From Wikipedia, the free encyclopedia
IA-64 (Arquitectura d'Intel Itanium) és l'arquitectura de conjunt d'instruccions (ISA) de la família de microprocessadors Intel de 64 bits Itanium descontinuada. L'especificació bàsica ISA es va originar a Hewlett-Packard (HP) i va ser implementada posteriorment per Intel en col·laboració amb HP. El primer processador Itanium, amb el nom en clau Merced, es va llançar l'any 2001.
 IA-64 | |
|---|---|
| Desenvolupador | Intel (mul)   |
| Característiques de CPUs | |
| Conjunt d'instruccions | x86-64 |
L'arquitectura Itanium es basa en un paral·lelisme explícit a nivell d'instruccions, en què el compilador decideix quines instruccions executar en paral·lel. Això contrasta amb les arquitectures superescalars, que depenen del processador per gestionar les dependències de les instruccions en temps d'execució. En tots els models Itanium, fins i tot Tukwila inclòs, els nuclis executen fins a sis instruccions per cicle de rellotge.
El 2008, Itanium va ser la quarta arquitectura de microprocessador més desplegada per a sistemes de classe empresarial, darrere de x86-64, Power ISA i SPARC.[1]
El 2019, Intel va anunciar la interrupció de l'última de les CPU que admetien l'arquitectura IA-64.
El 1989, HP va començar a preocupar-se que les arquitectures de computació de conjunts d'instruccions reduïts (RISC) s'acostaven al límit de processament d'una instrucció per cicle. Tant els investigadors d'Intel com d'HP havien estat explorant opcions d'arquitectura d'ordinadors per a dissenys futurs i per separat van començar a investigar un nou concepte conegut com a paraula d'instrucció molt llarga (VLIW) [2] que va sorgir de la investigació de la Universitat Yale a principis dels anys vuitanta.
VLIW és un concepte d'arquitectura informàtica (com RISC i CISC) on una sola paraula d'instrucció conté múltiples instruccions codificades en una paraula d'instrucció molt llarga per facilitar que el processador executi múltiples instruccions en cada cicle de rellotge. Les implementacions típiques de VLIW depenen molt de compiladors sofisticats per determinar en temps de compilació quines instruccions es poden executar al mateix temps i la programació adequada d'aquestes instruccions per a l'execució i també per ajudar a predir la direcció de les operacions de la branca. El valor d'aquest enfocament és fer un treball més útil en menys cicles de rellotge i simplificar la programació d'instruccions del processador i els requisits de maquinari de predicció de branques, amb una penalització en l'augment de la complexitat del processador, el cost i el consum d'energia a canvi d'una execució més ràpida.
Durant aquest temps, HP havia començat a creure que ja no era rendible per a empreses de sistemes empresarials individuals com ella desenvolupar microprocessadors propietaris. Intel també havia estat investigant diverses opcions arquitectòniques per anar més enllà de l'ISA x86 per abordar els requisits de servidors empresarials de gamma alta i informàtica d'alt rendiment (HPC).
Els esforços de màrqueting de productes i implicació de la indústria d'Intel van ser substancials i van aconseguir guanys de disseny amb la majoria dels OEM de servidors empresarials, inclosos els basats en processadors RISC en aquell moment. Els analistes del sector van predir que IA-64 dominaria en servidors, estacions de treball i ordinadors de sobretaula de gamma alta i, finalment, substituiria les arquitectures RISC i CISC per a totes les aplicacions de propòsit general.[3][4] Compaq i Silicon Graphics van decidir abandonar el desenvolupament posterior de les arquitectures Alpha i MIPS respectivament a favor de migrar a IA-64.[5]
Intel ha documentat àmpliament el conjunt d'instruccions Itanium [6] i la premsa tècnica n'ha proporcionat una descripció general.[7][8]
L'arquitectura ha estat rebatejada diverses vegades al llarg de la seva història. HP originalment el va anomenar PA-WideWord. Intel més tard el va anomenar IA-64, aleshores Itanium Processor Architecture (IPA),[9] abans d'establir-se per Intel Itanium Architecture, però encara es coneix àmpliament com IA-64.
És una arquitectura explícitament paral·lela rica en registres de 64 bits. La paraula de dades base és de 64 bits, adreçable per byte. L'espai d'adreces lògiques és de 264 bytes. L'arquitectura implementa predicció, especulació i predicció de branques. Utilitza finestres de registre de mida variable per passar paràmetres. El mateix mecanisme també s'utilitza per permetre l'execució paral·lela de bucles. L'especulació, la predicció, la predicció i el canvi de nom estan sota el control del compilador: cada paraula d'instrucció inclou bits addicionals per a això. Aquest enfocament és la característica distintiva de l'arquitectura.
L'arquitectura implementa un gran nombre de registres: [10][11][12]
gr 0 sempre diu 0.fr 0 sempre llegeix +0,0 i fr 1 sempre llegeix +1,0.pr 0 sempre diu 1 (cert).br 0 s'estableix a l'adreça de retorn quan es crida una funció amb br.call.bsp apunta a la segona pila, que és on el maquinari esborrarà automàticament els registres quan la finestra de registre s'embolica.Seamless Wikipedia browsing. On steroids.
Every time you click a link to Wikipedia, Wiktionary or Wikiquote in your browser's search results, it will show the modern Wikiwand interface.
Wikiwand extension is a five stars, simple, with minimum permission required to keep your browsing private, safe and transparent.
