ARM Cortex-X4是ARM在TCS23(整體計算解決方案)中推出的CPU 核心型號[1],它作為ARM Cortex-X3的後繼產品,X系列CPU核心普遍注重高效能,CPU核心可以與該系列中的其他內核配對,例如CPU叢集中的ARM Cortex-A720或/和ARM Cortex-A520[2]。[3][4][5]
產品化 | 2023 |
---|---|
設計團隊 | ARM Ltd. |
微架構 | ARM Cortex-X4 |
指令集架構 | ARMv9.2-A |
核心數量 | 1~10 每簇 |
一級快取 | 128 KiB (64 KiB I-cache with parity, 64 KiB D-cache) 每個核心 |
二級快取 | 512~2048 KiB 每個核心 |
三級快取 | 512 KiB ~ 32 MiB (可選) |
上代產品 | ARM Cortex-X3 |
繼任產品 | ARM Cortex-X925 |
相關產品 | ARM Cortex-A720 |
與ARM Cortex-X3相比的架構變化
- 微操作(MOP)快取:已刪除(之前為1.5k條目)
- 解碼寬度:10
- 重新命名/排程寬度:10(從8增加)
- 重新排序緩衝區(ROB):384個條目(從320個增加)
- 執行埠:21(從15增加)
- 管線長度:10(從9增加)
- 高達2 MiB的私有L2快取(從1 MiB增加)
- DSU-120
- 最多14個核心(之前為12個核心)
- 高達32 MiB的共用L3快取(從16 MiB增加)
- ARMv9.2
效能聲明:
架構比較
微架構 | Cortex-A78 | Cortex-X1 | Cortex-X2 | Cortex-X3 | Cortex-X4 | Cortex-X925 |
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峰值時鐘速度 | ~3.0 GHz | 〜3.25 GHz | ~3.4 GHz | |||
解碼寬度 | 4 | 5 | 6 | 10 [6] | ||
分發 | 6/周期 | 8/周期 | 10/周期 | |||
Max In-flight | 2x160 | 2x224 | 2x288 | 2x320 | 2x384 | |
L0(Mops entries) | 1536 [7] | 3,072 [7] | 1536 | 無[6] | ||
L1-I + L1-D | 32+32 KiB [8] | 64+64KB | ||||
L2 | 128–512 KiB | 0.256 – 1 MiB | 0.5 – 2 MiB | |||
L3 | 0–8 MiB | 0–16 MiB | 0–32 MiB | |||
指令集架構 | ARMv8.2 | ARMv9 | ARMv9.2 |
上市產品
另見
- ARM Cortex-A720,相關高效持續效能微架構
- ARM Cortex-A520,相關高效微架構
參考
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