RISC-V
开源指令集架构 / 维基百科,自由的 encyclopedia
RISC-V(英语发音为“risk-five”)是一个基于精简指令集(RISC)原则的开源指令集架构(ISA),简易解释为与开源软体运动相对应的一种“开源硬体”。该项目于2010年在加州大学柏克莱分校启动,但许多贡献者是该大学以外的志愿者和行业工作者。
Quick Facts 推出年份, 设计公司 ...
推出年份 | 2010年,14年前(2010) |
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设计公司 | 加州大学柏克莱分校 |
最新架构版本 |
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是否开放架构? | 是 |
体系结构类型 | 载入-储存架构 |
字长/暂存器资料宽度 | 32、64、128 |
位元组序 | 小端序 |
指令编码长度 | 不定长度 |
指令集架构设计策略 | RISC |
扩展指令集 | M、A、F、D、Q、C、P |
分支预测结构 | 比较和分支 |
通用暂存器 | 16、32(包括一个始终为零的寄存器) |
浮点寄存器 | 32(可选;宽度取决于选用的扩展指令集,可为32、64、128位元) |
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与大多数指令集相比,RISC-V指令集可以自由地用于任何目的,允许任何人设计、制造和销售RISC-V芯片和软件而不必支付给任何公司专利费。虽然这不是第一个开源指令集[1],但它具有重要意义,因为其设计使其适用于现代计算设备(如仓库规模云计算机、高端移动电话和微小嵌入式系统)。设计者考虑到了这些用途中的性能与功率效率。该指令集还具有众多支持的软件,这解决了新指令集通常的弱点。[2]
RISC-V指令集的设计考虑了小型、快速、低功耗的现实情况来实做,但并没有对特定的微架构做过度的设计。[3][4]
截至2021年12月,RISC-V工作小组已经批准了版本 20191213 的非特权指令集(Unprivileged ISA,曾经称为用户级指令集 User-Level ISA),以及版本 20211203 的特权指令集(Privileged ISA)。