File:MIPS_Architecture_(Pipelined).svg
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原始文件 (SVG文件,尺寸为800 × 500像素,文件大小:56 KB)
摘要
描述MIPS Architecture (Pipelined).svg |
English: The stage-by-stage architecture of a MIPS microprocessor with a pipeline. Although the memory is shown twice for clarity of the pipeline, MIPS architectures have only one memory bank (i.e. von Neumann architecture). |
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日期 | ||||
来源 | 自己的作品 | |||
作者 | Inductiveload | |||
授权 (二次使用本文件) |
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其他版本 | rkrkgkf | |||
SVG开发 InfoField |
说明
带有流水线的MIPS微处理器的逐级结构。虽然为了使流水线清晰,内存显示了两次,但MIPS架构只有一个内存库(即冯-诺依曼架构)。
此文件中描述的项目
描绘内容
某些值没有维基数据项目
22 1 2009
文件历史
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日期/时间 | 缩略图 | 大小 | 用户 | 备注 | |
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当前 | 2009年1月22日 (四) 17:08 | ![]() | 800 × 500(56 KB) | Inductiveload | {{Information |Description={{en|1=The stage-by-stage architecture of a MIPS microprocessor with a pipeline. Although the memory is shown twice for clarity of the pipeline, MIPS architectures have only one memory bank (i.e. von Neumann architecture).}} |So |
2009年1月22日 (四) 17:08 | ![]() | 800 × 500(56 KB) | Inductiveload | {{Information |Description={{en|1=The stage-by-stage architecture of a MIPS microprocessor with a pipeline. Although the memory is shown twice for clarity of the pipeline, MIPS architectures have only one memory bank (i.e. von Neumann architecture).}} |So |
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元数据
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宽度 | 800 |
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高度 | 500 |